طراحی و شبیه سازی سلول تمام جمع کننده دیجیتال پر بازده بر پایه cntfet

توجه : به همراه فایل word این محصول فایل پاورپوینت (PowerPoint) و اسلاید های آن به صورت هدیه ارائه خواهد شد

 طراحی و شبیه سازی سلول تمام جمع کننده دیجیتال پر بازده بر پایه cntfet دارای ۱۶ صفحه می باشد و دارای تنظیمات در microsoft word می باشد و آماده پرینت یا چاپ است

فایل ورد طراحی و شبیه سازی سلول تمام جمع کننده دیجیتال پر بازده بر پایه cntfet  کاملا فرمت بندی و تنظیم شده در استاندارد دانشگاه  و مراکز دولتی می باشد.

توجه : در صورت  مشاهده  بهم ریختگی احتمالی در متون زیر ،دلیل ان کپی کردن این مطالب از داخل فایل ورد می باشد و در فایل اصلی طراحی و شبیه سازی سلول تمام جمع کننده دیجیتال پر بازده بر پایه cntfet،به هیچ وجه بهم ریختگی وجود ندارد

بخشی از متن طراحی و شبیه سازی سلول تمام جمع کننده دیجیتال پر بازده بر پایه cntfet :

تعداد صفحات :۱۶

چکیده مقاله:

مدار تمام جمع کننده، به دلیل توانایی در پیاده سازی چهار عمل اصلی محاسباتی )جمع، تفریق، ضرب و تقسیم( به عنوان یکی از مهمترین و پرکاربردترین بخشهای اصلی پردازنده های دیجیتالی در طراحی مدارهای مجتمع، شناخته می شود. از آنجایی که در سال های اخیر ترانزیستور های CNTFET بازدهبهتری به نسبت MOSFET داشته ، در این پژوهش تلاش شده است که سلول تمام جمع کنندی جدیدی با بهره گیری از تکنولوژی ترانزیستورهای نانولوله ی کربنی، جهت دستیابی به مداری با عملکردی مناسب و توان مصرفی کم، ارایه گردد. طرح پیشنهادی با استفاده از ۲۶ ترانزیستور نانو لولهکربنی و با استفاده از ساختار xor/xnor پیاده سازی شده است . شبیه سازی مدار با نرم افزار hspice و در ولتاژ ۹ / ۰ ولت انجام گرفته است و در پایان مقایسه ای میان مدار پیشنهادی و مدل های پیشین صورت گرفته است .