طراحی و شبیه سازی ضرب کننده سریال تپشی برای اعداد طولانی با VHDL

توجه : به همراه فایل word این محصول فایل پاورپوینت (PowerPoint) و اسلاید های آن به صورت هدیه ارائه خواهد شد

 طراحی و شبیه سازی ضرب کننده سریال تپشی برای اعداد طولانی با VHDL دارای ۱۸ صفحه می باشد و دارای تنظیمات در microsoft word می باشد و آماده پرینت یا چاپ است

فایل ورد طراحی و شبیه سازی ضرب کننده سریال تپشی برای اعداد طولانی با VHDL  کاملا فرمت بندی و تنظیم شده در استاندارد دانشگاه  و مراکز دولتی می باشد.

توجه : در صورت  مشاهده  بهم ریختگی احتمالی در متون زیر ،دلیل ان کپی کردن این مطالب از داخل فایل ورد می باشد و در فایل اصلی طراحی و شبیه سازی ضرب کننده سریال تپشی برای اعداد طولانی با VHDL،به هیچ وجه بهم ریختگی وجود ندارد

بخشی از متن طراحی و شبیه سازی ضرب کننده سریال تپشی برای اعداد طولانی با VHDL :

نام کنفرانس، همایش یا نشریه : استقلال

تعداد صفحات :۱۸

در این کار روند طراحی و مدلسازی یک ضرب کننده سریال تپشی برای اعداد بدون علامت با کمک زبان توصیف سخت افزار VHDL بر روی FPGA بررسی می شود. در این روش حاصل ضرب به صورت کامل بدون وارد کردن کلمه صفر بین دو داده متوالی، روی خطوط خروجی ظاهر می شود. ضرب کننده پیشنهادی بر اساس یک ضرب کننده سری/ موازی که با بهره وری ۱۰۰% کار می کند، پایه گذاری شده است، که محاسبات قسمت کم ارزش و قسمت پرارزش حاصل در دو مرحله که همپوشانی دارند، انجام می شود. با حذف تعدادی از عناصر تاخیر و نیز ادغام هر دو سلول مجاور در مدار مورد نظر، مدار به صورت تپشی کار خواهد کرد. ضمن اینکه با اعمال تغییراتی در ورودی موازی، هر دو ورودی مدار می توانند به صورت سری اعمال شوند. از جنبه های مهم این طرح این است که حاصلضرب به صورت کامل، سریع و بدون تاخیر به دست می آید. در نتیجه برای ضرب اعداد طولانی به صورت پیوسته مناسب است. مدار پیشنهاد شده ضمن داشتن مزایای ذکر شده از لحاظ حجم سخت افزار مورد نیاز تفاوت چندانی با مدارهای مشابه قبلی ندارد.

کلید واژه: ضرب کننده سریال، آرایه های تپشی، FPCGA, VHDL