مقاله طراحی و پیاده سازی الگوریتم استاندارد رمزنگاری پیشرفته (AES) به صورت خط لوله ای بر روی سخت افزار FPGA

توجه : به همراه فایل word این محصول فایل پاورپوینت (PowerPoint) و اسلاید های آن به صورت هدیه ارائه خواهد شد

  مقاله طراحی و پیاده سازی الگوریتم استاندارد رمزنگاری پیشرفته (AES) به صورت خط لوله ای بر روی سخت افزار FPGA دارای ۸ صفحه می باشد و دارای تنظیمات در microsoft word می باشد و آماده پرینت یا چاپ است

فایل ورد مقاله طراحی و پیاده سازی الگوریتم استاندارد رمزنگاری پیشرفته (AES) به صورت خط لوله ای بر روی سخت افزار FPGA  کاملا فرمت بندی و تنظیم شده در استاندارد دانشگاه  و مراکز دولتی می باشد.

توجه : در صورت  مشاهده  بهم ریختگی احتمالی در متون زیر ،دلیل ان کپی کردن این مطالب از داخل فایل ورد می باشد و در فایل اصلی مقاله طراحی و پیاده سازی الگوریتم استاندارد رمزنگاری پیشرفته (AES) به صورت خط لوله ای بر روی سخت افزار FPGA،به هیچ وجه بهم ریختگی وجود ندارد

بخشی از متن مقاله طراحی و پیاده سازی الگوریتم استاندارد رمزنگاری پیشرفته (AES) به صورت خط لوله ای بر روی سخت افزار FPGA :

تعداد صفحات:۸
چکیده:
پس از معرفی استاندارد رمزنگاری پیشرفته (AES) به عنوان الگوریتم رمز استاندارد در اکتبر سال ۲۰۰۰ میلادی توسط NIST ، استفاده از آن به طور گسترده در کاربردهای مختلف سخت افزاری و نرم افزاری مورد توجه قرار گرفت. در این مقاله، ابتدا انواع الگوریتم های رمزنگاری AES مورد بررسی قرار گرفت. سپس مدل هایی برای پیاده سازی این الگوریتم بر روی FPGA ارائه خواهد شد که از نظر حجم سخت افزار مصرفی و بازدهی کارآمد باشد. برای رسیدن به این هدف، از معماری خط لوله (Pipeline) بر روی FPGA انجام گرفت. در این روش که برای کاربردهای بر سرعت طراحی شده است از معماری خط لوله به طول های ۱۰، ۲۰ و ۴۰ استفاده شده است. که نتایج سنتز رمزکننده های پیشنهادی، گویای صحت عملکرد و کارایی مناسب روش ها می باشد و حداکثر بازدهی ۵۹۷۷۶Gbps را برآورده می سازد.